Lezioni ed esercitazioni |
Ore |
Argomenti |
Contenuti specifici |
|
L’architettura base del processore |
L’ISA. I blocchi di controllo e datapath. Controllo hardwired. Controllo microprogrammato.
|
10 |
L’architettura a pipeline |
Struttura della pipeline. Pipeline hazards: structural hazards, data hazards, control hazards. La pipeline per istruzioni a cicli multipli.
|
10 |
Sfruttamento del parallelismo a livello istruzione (ILP) |
Concetti e proprietà principali. Scheduling dinamico: Tomasulo. Branch prediction statico e dinamico. Architetture a Issue Multipla. Approcci evolutivi: le architetture superscalari. Approcci rivoluzionari: le architetture VLIW. Il parallelismo a livello registro. Applicazioni a processori RISC e DSP. |
10 |
Architetture non convenzionali |
Sistemi per l’elaborazione non algoritmica dell’informazione. Architetture parallele. Processori per i linguaggi ad alto livello.
|
10 |
Totale ore lezioni ed esercitazioni |
40 |
di cui di esercitazione |
|
Ulteriori attività di didattica assistita
|
Ore
|
Laboratorio |
|
Seminari e/o testimonianze |
|
Corsi integrativi |
|
Visite guidate |
|
|
|
Totale ore dedicate ad altre attività di didattica
assistita |
0 |
Totale ore complessive |
40
|